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논문 기본 정보
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- 저자정보
- 저널정보
- 대한전자공학회 ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications ITC-CSCC : 2009
- 발행연도
- 2009.7
- 수록면
- 457 - 460 (4page)
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In this paper, a sigma-delta (Σ-Δ) analog-to-digital converter (ADC) is presented with 14.97-bit accuracy. The ADC is composed of fourth-order single-loop single-bit sigma-delta (Σ-Δ) modulator and digital decimation filter. The modulator with an oversampling ratio of 128 and a signal bandwidth of 4㎑ has been designed in a 0.35㎛ CMOS technology. The designed decimation filter has been verified using an FPGA. The Σ-Δ modulator consumes 3㎽ from a single 3.3V supply voltage.
목차
Abstract
1. INTRODUCTION
2. Σ-Δ ADC ARCHITECTRE
3. IMPLEMENTATION
4. EXPERIMENTAL RESULTS
5. CONCLUSION
References
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