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논문 기본 정보

자료유형
학술저널
저자정보
김두연 (고려대학교) 정재진 (고려대학교) 임신일 (서경대학교) 김석기 (고려대학교)
저널정보
대한전기학회 전기학회논문지 전기학회논문지 제59권 제2호
발행연도
2010.2
수록면
355 - 358 (4page)

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As CMOS technology continues to scale down, signal processing is favorably done in the digital domain, which requires Analog-to-Digital(A/D) Converter to be integrated on-chip. This paper presents a design methodology of 12-bit 1-MS/s Rail-to-Rail fully differential SAR　ADC using Deep N-well Switch based on binary search algorithm. Proposed A/D Converter has the following architecture and techniques. Firstly, chip size and power consumption is reduced due to split capacitor array architecture and charge recycling method. Secondly, fully differential architecture is used to reduce noise between the digital part and converters. Finally, to reduce the mismatch effect and noise error, the circuit is designed to be available for Rail-to-Rail input range using simple Deep N-well switch. The A/D Converter fabricated in a TSMC 0.18um 1P6M CMOS technology and has a Signal-to-Noise-and-Distortion-Ratio(SNDR) of 69 ㏈ and Free-Dynamic-Range (SFDR) of 73 ㏈. The occupied active area is 0.6㎟
#Successive Approximation Register(SAR) #ADC #Rail-to-Rail #DNW #Split capacitor

목차

Abstract
1. 서론
2. SAR ADC 구현
3. 결론
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