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논문 기본 정보

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저자정보
저널정보
대한전자공학회 대한전자공학회 학술대회 대한전자공학회 2009년 SoC학술대회
발행연도
2009.5
수록면
103 - 106 (4page)

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본 논문은 H.264/AVC 디코더에서 사용되는 CAVLC 회로를 기술한다 본 논문은 복호화 과정에 필요한 사이클 수를 줄이기 위하여 3가지 새로운 방법을 제안한다. 첫 번째는 5단계로 수행되는 복호화를 3단계로 줄이는 것이다. 두 번째는 누산기에 의한 지연시간을 제거하는 것이다. 세 번째는 불필요한 사이클을 없애는 것이다. 제안된 방식을 이용하여 설계한 결과, 비슷한 크기의 회로로 60% 이상 성능을 향상시켰다. 130㎚ 공정의 표준 셀 라이브러리를 사용하여 최대 250㎒의 동작주파수에서 19,175개의 게이트로 구성된 논리 수준 회로를 구현하였다.

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. CAVLC 복호화 방식
Ⅲ. 실험결과
Ⅳ. 결론
Acknowledgements
참고문헌

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