비행제어 컴퓨터의 Throughput 향상 및 Power-Interruption 대처 설계

이철; 서준호; 함흥빈; 조인제; 윤형식

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자료유형: 학술저널

저자정보: 이철 서준호 함흥빈 조인제 윤형식

저널정보: 한국항공우주학회 한국항공우주학회지 韓國航空宇宙學會誌第35卷第10號

발행연도: 2007.10

수록면: 940 - 947 (8page)

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초음속 전투기급 비행제어 컴퓨터(FLCC)의 성능향상을 위해 프로세서(CPU) 및 CPU 보드의 형상이 변경되었으며, 하드웨어형상 확정 단계에서 정확한 실시간 처리량 예측이 필요하였다. 본 연구에서는 실시간 처리량 예측을 위한 실험적 방법이 시도되었다. 기존 FLCC를 정상 동작시키며 한 Sampling Time 동안 CPU(SMJ320C40) Address Bus 데이터를 획득 및 디코드하여 메모리별 접근 및 분기 횟수를 측정하였다. 측정된 데이터를 통해, 신규 FLCC CPU(SMJ320C601) Demo Board를 제작하여 정확한 실시간 처리량 예측시험을 수행하였으며, 시험결과를 통해 CPU-Memory Architecture를 조기에 변경할 수 있었다. 특히 설계 변경에 따른 문제점들 중의 하나인 Power- Interruption에 대한 비행 안정성 저하여부를 판단하기 위하여 HILS (Hardware-In-the Loop Simulator)를 통한 비행검증시험이 수행되었다.

#Fly-By-Wire FLCC(전자식 비행제어 컴퓨터) #Throughput (실시간 처리량) #OFP(비행운용 소프트웨어)

참고문헌 (6)

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1. [보고서] - 김태경 / 1995 / 다목적 실용위성 원격측정 명령계개발사업(I)

2. [단행본] - Wiley J. Larson / 1993 / Space Mission Analysis and Design / Microcosm Inc : 603 ~ 635

3. [기타자료] - Terrence. M. Shindler / 2004 / System Description Document for the T-50 Flight Control System / Lockheed Martin Aeronautics Company

4. [기타자료] - Keith Edgell / 2000 / Specification for the Flight Control Computer for the KTX-2 Aircraft / Lockheed Martin Aeronautics Company

5. [기타자료] - Texas Instrument / 1999 / TMS320C4x User's Guide

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