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Korean Institute of Information Scientists and Engineers 한국정보과학회 학술발표논문집 한국정보과학회 2008 가을 학술발표논문집 제35권 제2호(B)
발행연도
2008.10
수록면
221 - 224 (4page)

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Flexible programmability has become the key issue in polygon-based rasterization on 3D graphics hardware in endowing realism to the final image displayed. Yet, data parallelism must also be exploited in order to ensure performance at interactive rate. In this paper, a new hierarchical architecture based on both MIMD and SIMD, otherwise known as heterogeneous chip multiprocessing, is presented along with dynamically allocated nodes to provide load balancing in 3D graphics, physics simulation, and general-purpose programming.

목차

Abstract
1. Introduction
2. Related Work
3. Graphics Processing Architectures
4. Dynamic Allocation of Processing Units
5. Conclusion
References

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