다중버스 아키텍처 구조에서 고성능 DMA를 이용한 TFT-LCD Controller 구현

이국표; 이근환; 윤영섭

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자료유형: 학술저널

저자정보: 이국표 이근환 윤영섭

저널정보: 대한전자공학회 전자공학회논문지-SD 電子工學會論文誌 SD編第45卷第8號

발행연도: 2008.8

수록면: 54 - 60 (7page)

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버스 아키텍처는 통신 전송을 만드는 마스터, 전송을 응답받는 슬레이브, 마스터를 선택하는 아비터, 그리고 버스를 연결해주는 브리지 등으로 구성되어 있다. 이것은 최근에 좀 더 복잡해지고 있으며, 다중버스 아키텍처로 발전하고 있다. 본 논문에서는 여러 다중 shared bus 구조에 대해 논의해 보고 브리지의 레이턴시를 줄이기 위해서 메모리 셀렉터를 도입한 구조를 제안하였다. 마지막으로 이 버스구조에 DMA 마스터를 사용하는 LCD 컨트롤러를 집적하였으며, RTL 시뮬레이션과 FPGA 보드테스트를 통하여 검증하였다. ModelSim 툴을 이용한 타이밍 시뮬레이션에서 DMA, LCD 라인버퍼, SDRAM 컨트롤러 등이 정상적으로 동작되었으며, LCD 패널이 장착된 실제 FPGA 보드에서 LCD 이미지를 확인하였다.

#TFT-LCD controller #DMA #FPGA #bus architecture

참고문헌 (8)

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1. [학술지(정기간행물)] - R. Lu / 2007 / SAMBA-Bus: A High Performance Bus Architecture for System- on-Chips / IEEE Trans. on VLSI Systems 15 (1) : 69 ~ 79

2. [학술지(정기간행물)] - M. Anders / 1997 / A transition-encoded dynamic bus technique for high-performance interconnects / IEEE J. Solid-State Circuits 5 (4) : 444 ~ 454

3. [학술지(정기간행물)] - K. Lahiri / 2004 / Design Space Exploration for Optimizing On- Chip Communication Architectures / IEEE Trans. Computer-Aided Design 23 : 952 ~ 961

4. [학술지(정기간행물)] - K. Lahiri / 2001 / System-Level Performance Analysis for DesigningOn-ChipCommunication Architectures / IEEE Trans. Computer-Aided Design 20 (6) : 768 ~ 783

5. [기타자료] - / 1999 / AMBA TM Specification(AHB) (Rev 2.0) / ARM Ltd

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