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학술대회자료
저자정보
서병현 (단국대학교) 김규철 (단국대학교)
저널정보
대한전자공학회 대한전자공학회 학술대회 2008년도 SOC 학술대회
발행연도
2008.5
수록면
85 - 88 (4page)

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본 논문에서는 통신 패턴에 따라 효율적인 전송이 가능하도록 하기 위해서 다중버스 모드와 단일버스 모드 사이의 동적 재구성이 가능한 버스 구조를 VHDL을 이용하여 Quartus4.2에서 설계하고, Modelsim6.0에서 시뮬레이션 검증하였다. 제안된 버스 구조의 동작은 전송되는 통신 패턴을 이용하여 버스 구조를 적절히 선택할 수 있는 재환경 설정 블록과 이 블록으로부터 받은 제어신호를 이용하여 입력단과 출력단을 바로 연결할 수 있는 바이-패스 브리지를 사용하여 구현하였다. 버스 접근빈도가 높은 마스터를 디폴트 마스터 (Default Master)로 설정함으로써 초기 버스 접근 시간을 줄일 수 있다. 실험 결과 제안된 버스구조는 다중버스 구조보다 평균 45%이상의 전송시간 단축을 보였다.
#동적재구성 #시스템온칩 #버스구조 #데이터전송

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 동적 재구성이 가능한 버스 구조
Ⅲ. 실험
Ⅳ. 결론
참고문헌

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