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논문 기본 정보

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대한전자공학회 전자공학회논문지-SD 電子工學會論文誌 SD編 第44卷 第2號
발행연도
2007.2
수록면
86 - 94 (9page)

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네트워크-온-칩(NoC, network-on-chip) 기술은 SoC (system-on-a-chip) 설계에서 증가되는 온칩 통신의 복잡성을 해결하고 높은 확장성을 제공할 수 있는 기술이다. NoC를 이용한 설계는 많은 수의 IP들과 통신 네트워크들을 사용하기 때문에 동작이 복잡하고 설계 공간이 커서 많은 전력을 소모 한다. 그러나 기존의 분석적인 방법은 NoC응용의 큰 설계 공간 및 동작의 복잡성에 비해 상대적으로 간소화된 모델을 사용하여 현실적인 설계요소를 반영하지 못하거나 복잡한 시뮬레이션에 따른 많은 노력 및 시간 요구로 사용에 많은 제약이 있었다. 따라서 본 논문에서는 현실적이고 정확한 NoC의 전력 소모 분석을 위해 FPGA 프로토타입(prototype)을 개발하고 이에 대한 전력 소모를 분석을 할 수 있는 싸이클별 전력 소모 측정 기법 및 도구를 소개한다. 또한 사례 연구로서 NoC기술을 이용한 JPEG 압축기를 구현하고 이에 대한 전력 소모를 분석하여 그 효용성을 입증한다.
#FPGA prototype #Power analysis #JPEG encoder #NoC #SoC

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 관련 연구
Ⅲ. 싸이클별 에너지 소모 측정
Ⅳ. 사례 연구: JPEG 압축기의 전력 소모 분석
Ⅴ. 결론
참고문헌
저자소개

참고문헌 (22)

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, 2001 , Route packets, not wires: On-chip interconnection networks google schola , 2002 , Networks on chips: A new SoC paradigm 35 (1) google schola , 2003 , Networks on Chip google schola , 2004 , A Case Study in Networks-on-Chip Design for Embedded Video google schola , 2002 , Analysis of power consumption on switch fabrics in network routers google schola

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