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대한전자공학회 전자공학회논문지-CI 電子工學會論文誌 CI編 第44卷 第1號
발행연도
2007.1
수록면
1 - 9 (9page)

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임베디드 프로세서는 총 에너지소모량 가운데 대략 40% 이상을 캐시에서 소모하고 있으므로 에너지-효율적 고성능 데이터 캐시 구조를 필요로 한다. 본 논문에서는 임베디드 프로세서를 위한 저전력 선인출 데이터캐시 구조를 제안하였다. 제안한 데이터캐시 구조는 선인출장치(prefetching unit)를 포함한 기존 데이터캐시 구조에 태그히스토리 테이블(tag history table)을 구비함으로써 요구인출 및 선인출시 발생하는 태그메모리 병렬탐색 횟수를 감소시켰다. 이와 같은 전략적인 캐시 구조는 적은 하드웨어 비용으로 병렬탐색을 위한 전력소모를 현저히 줄일 수 있다. 실험을 통하여 제안한 데이터캐시 구조가 기존 선인출 데이터캐시 구조와 동일한 성능을 유지하면서 낮은 전력을 요구함을 확인하였다.
#embedded processor #data cache #low-power #data prefetching #tag history table

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 실험
Ⅳ. 결론
참고문헌
저자소개

참고문헌 (15)

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1. [학술지(정기간행물)] - / apr.2001. / Power: A First-Class Architectural Design Constraint 34 : 52 ~ 58 google schola 2. [학술지(정기간행물)] - / Jan.2003. / Analog and CPU Wizards Reduce Digital Power: National Semiconductor and ARM Increase Battery Life 17 (1) : 10 ~ 14 google schola 3. [학술지(정기간행물)] - / 1978. / Sequential Program Prefetching in Memory Hierarchies 11 : 7 ~ 21 google schola 4. [학술지(정기간행물)] - / 2004. / An Energy Efficient High Performance Scratch-pad Memory System google schola 5. [학술지(정기간행물)] - / aug.1993. / Fixed and Adaptive Sequential Prefetching in Shared-memory Multiprocessors : 56 ~ 63 google schola

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