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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2013.9
- 수록면
- 11 - 19 (9page)
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프로세서와 메모리 시스템 사이의 속도 차이를 완화하기 위하여 오늘날의 컴퓨터 시스템은 대부분 캐시 시스템을 사용하고 있다. 하지만 소비 전력 측면에서 캐시 메모리는 전체 시스템 측면에서 큰 비중을 차지한다. 본 논문에서는 캐시 시스템의 전력을 줄이는 방안 가운데 하나로 지역 버퍼와 주소 압축을 통한 저전력 캐시 설계 기법을 제안한다. 주소 압축을 위해 사용되는 부분태그 캐시는 전력 소모량을 최소화하기 위해서 전체 태그를 쓰기보다는 태그의 작은 부분을 사용함으로써 소비 전력을 줄이도록 하는 기법이다. 본 논문에서는 기존의 여러 주소 압축 캐시 연구에서의 문제점들을 분석하여 그것을 보완할 수 있는 새로운 기법을 제안한다. 제안된 기법은 지역성이 높은 내장형 응용프로그램의 특징을 활용한 것으로, 지역 버퍼와 지역 실패 버퍼를 활용한 새로운 형태의 캐시 주소 압축 기법이다. 모의실험 결과, 제안된 기법은 전체적인 성능의 감소 없이 평균 18%의 에너지 감소를 보였다.
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참고문헌 (13)
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1. [단행본] - Patterson, D. A / 2007 / Computer architecture: a quantitative approach / Morgan Kaufman
2. [학술대회논문] - S. Segars / 2001 / Low power design techniques for microprocessor / International solid-State Circuit conference
3. [기타자료] - / 2010 / ARMv7-M Architecture Reference Model / ARM DDI 0403C
4. [학술대회논문] - A. Malik / 2000 / A Lower Power Unified Cache Architecture Providing Power and Performance Flexibility / ISLPED’00 : 241 ~ 243
5. [학술대회논문] - Gennady Pekhimenko / 2012 / Linearly compressed pages: a main memory compression framework with low complexity and low latency / PACT '12 489 (490) : 489 ~ 490
2. [학술대회논문] - S. Segars / 2001 / Low power design techniques for microprocessor / International solid-State Circuit conference
3. [기타자료] - / 2010 / ARMv7-M Architecture Reference Model / ARM DDI 0403C
4. [학술대회논문] - A. Malik / 2000 / A Lower Power Unified Cache Architecture Providing Power and Performance Flexibility / ISLPED’00 : 241 ~ 243
5. [학술대회논문] - Gennady Pekhimenko / 2012 / Linearly compressed pages: a main memory compression framework with low complexity and low latency / PACT '12 489 (490) : 489 ~ 490
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