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FPGA를 사용한 시제품 제작은 ASIC을 사용하여 하드웨어를 구현하는 경우에, 설계 오류로 인한 비용 및 개발기간 증가를 피하기 위하여, 중간 검증 단계로서 많이 사용된다. 그렇지만 ASIC에 비하여 상대적으로 긴 FPGA의 전달 지연으로 인하여, 실제 운용 환경에서 FPGA로 구현된 시제품의 검증을 수행하기 어려운 경우가 흔희 존재한다.
본 논문에서는 이러한 문제를 해결하기 위하여, FPGA를 사용한 중간 단계의 시제품을 효과적이며 정확하게 검증하는 방법을 제공하기 위 ... 전체 초록 보기

목차

요약

1. 서론

2. SAVE 시스템의 구조

3. 적용 예

4. 결론 및 향후 연구 과제

참고문헌

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