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논문 기본 정보
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- Korean Institute of Information Scientists and Engineers 한국정보과학회 학술발표논문집 한국정보과학회 1994년도 봄 학술발표논문집 제21권 제1호
- 발행연도
- 1994.4
- 수록면
- 285 - 288 (4page)
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이진영상 인식에 있어서 전처리(잡음제거 및 세선화)는 올바른 인식을 위해 매우 중요하며 필수적인 단계이다. 여러가지 구체적인 알고리즘을 소프트웨어로 구현할 경우 많은 반복연산으로 인해 수행시간이 길어지므로 하드웨어로 구현하여 고속으로 실시간 처리가 가능하도록 할 필요성이 대두되었다. 하드웨어로 구현하기 위해서, 비교적 적은 수의 마스크를 사용하면서 효율적으로 잡음제거 및 세선화를 수행할 수 있고, 병렬 처리가 가능한 알고리즘을 선택하여 칩을 설계하였다. 칩 설계시 VHDL로 모델링을 하였고, 이것을 시뮬레이션을 통해 검증한 후 FPGA 라이브러리를 써서 논리합성율하고, FPGA로 칩을 제작하였다.
목차
요약
1. 서론
2. 전처리 알고리즘
3. 설계
4. 결론 및 행후 개선 보완점
참고문헌
참고문헌 (0)
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