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대한전자공학회 전자공학회논문지-TC 전자공학회논문지 TC편 제42권 제8호
발행연도
2005.8
수록면
17 - 24 (8page)

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본 논문에서는 Blind 채널 등화를 위한 error feedback 필터를 갖는 Decision Feedback Equalizer(DFE) 구조의 등화기를 설계하였다. 제안하는 등화기는 Least Mean Square(LMS) 알고리즘과 Multi-Modulus Algorithm(MMA)을 이용하였으며 64/256 QAM을 위해 설계되었다. 기존의 MMA 등화기는 두개의 transversal 필터를 이용하거나 feedforward와 feedback 필터를 이용하는 반면에 제안하는 등화기는 feedforward와 feedback 그리고 error feedback 필터를 사용하여 채널 적응 성능을 향상시켰으며 탭 수를 감소시켰다. 제안하는 구조는 SPW^(TM) 툴을 이용 시뮬레이션을 수행하여 성능을 개선시킬 수 있었다. 그리고 VHDL을 이용해 시뮬레이션을 수행하였으며 논리 합성은 0.25um 셀 라이브러리를 이용하였다. 설계한 등화기는 약 19만 게이트 수와 15㎒의 동작속도를 보였다. 또한 FPGA 칩을 내장한 이뮬레이션 보드를 사용하여 성능 검증을 수행하였다.

목차

요약

Abstract

Ⅰ. 서론

Ⅱ. 기존의 MMA 알고리즘과 등화기의 구조

Ⅲ. 제안한 MMA 알고리즘과 등화기의 구조

Ⅳ. 시뮬레이션 및 논리 합성 결과

Ⅴ. 결론

참고문헌

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