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Korean Institute of Information Scientists and Engineers 한국정보과학회 학술발표논문집 한국정보과학회 2002년도 봄 학술발표논문집 제29권 제1호(A)
발행연도
2002.4
수록면
664 - 666 (3page)

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현대의 Deep-Submicron Technology(DSM)에서 배선은 논리 구성요소들보다 더욱 중요한 위치를 차지하게 되었다. 최근에, [2]는 연산 회로를 합성하기 위해 비트 단위의 최적 지연시간의 partial product reduction tree(PPRT)를 생성하는 방법을 제시하였고, 이는 현재의 최적 지연시간을 갖는 회로를 능가한다. 그러나, [2]를 포함하는 기존의 합성방법에서는, 합성의 복잡함이나, 배선에서 발생하는 여러 ... 전체 초록 보기

목차

요약

1. 서론

2. CSA트리와 지연시간 모델

3. 배선을 고려한 합성

4. 실험 결과

5. 결론

감사의 글

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