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한국전자파학회 한국전자파학회논문지 한국전자파학회논문지 제15권 제12호
발행연도
2004.12
수록면
1,161 - 1,167 (7page)

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기존의 PLL(phase locked loop)은 폐루프 구조이므로 주파수 스위칭 속도가 낮은 단점을 갖는다. 이를 개선하기 위해서 개루프 구조를 혼합한 Digital Hybrid PLL 구조를 연구하였다. 또한 이 구조는 빠른 주파수 스위칭 속도로 동작할 수 있지만, VCO의 전압대 주파수 전달특성을 ROM 형태로 구현하는 DLT(digital look-up table) 이 사용되어야 하므로 회로소자가 많아지고 소비전력이 증가된다. 그러므로, 본 논문에서는 복잡한 DLT의 구조를 간단한 Digital logic 회로로 대체시킨 새로운 구조를 제안하였다. 또한 주파수 합성때마다 타이밍 동기화를 이루는 회로를 설계하여 합성기의 항상성을 확보하였으며 DLT를 사용하는 방식과 비교하여 회로소자들 약 28% 정도 줄일 수 있다. 고속 스위칭 동작 특성과 주파수 합성을 시뮬레이션과 실제 회로 구현으로 확인하였다.

목차

요약

Abstract

Ⅰ. 서론

Ⅱ. DH-PLL 기본 구조

Ⅲ. 제안하는 DH-PLL 구조

Ⅳ. 시뮬레이션

Ⅴ. 회로 구현 및 성능 분석

Ⅵ. 결론

참고문헌

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UCI(KEPA) : I410-ECN-0101-2009-427-014434428