저전력 소비를 위한 저전압 스윙 도미노 로직

양성현; 김두환; 조경록

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자료유형: 학술저널

저자정보: 양성현 김두환 조경록

저널정보: 대한전자공학회 전자공학회논문지-SC 전자공학회논문지 제41권 SC편 제6호

발행연도: 2004.11

수록면: 333 - 341 (9page)

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본 논문에서는, 저전력 소비를 위한 새로운 저전압 스윙 도미노 로직 회로를 제안한다. 전력 소비를 줄이기 위해, 도미노 로직의 예비충전(precharge) 노드와 출력 노드자 OV부터 VREF-VTH까지 범위에서 스윙하도록 설계하도록 설계하였다. 여기서, VREF=VDD-nVTH (N=0, 1, 2, 3)로 정의되며 설계자는 요구되는 속도와 전력 소비 특성을 감안하여 n값을 설정할 수 있다. 이 와 같은 특성은 누설 전류 없이 저전압 입력을 받을수 있는 인버터의 구조에 의해얻어진다. 제안된 도미노 로직을 적용하여 4×4 Braun 곱셈기를 설계하였고 공급저압 3.3V를 갖는 0.35㎛ n-well CMOS 공정으로 제작하였다. 제작된 칩은 기존 회로들과 비교할 때, 30％ 이상의 전력 감소효과를 나타내며 전력-지연 곱에서도 우수한 성능을 나타내었다.

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[학술지(정기간행물)] - / 1998 / Low-power domino logic multiplier using low-swing techni -que 2 : 45 ~ 48

[학술지(정기간행물)] - / 1997. / Design of low power CMOS drivers based on charge recycling iii : 1924 ~ 1927

[학술지(정기간행물)] - / 1999 / Low-swing/low power driver architecture 2 : 639 ~ 642

[학술지(정기간행물)] - / / Accurate simulation of power dissipation in VLSI circuits sc-21 (5) : 889 ~ 891 1986

[학술지(정기간행물)] - / 1996 / CMOS Digital Integrated Circuits

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