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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2004.10
- 수록면
- 79 - 86 (8page)
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본 논문은 0.35㎛ CMOS 공정을 이용하여 1.07GHz와 2.07GHz의 주파수를 생성해내는 이중 내역 전압 제어 발진기를 제안한다. 50% 듀티 싸이클 회로와 반가산기를 가진 제안된 전압 제어 발진기는 일반적인 전압 제어 발진기의 주파수보다 두 배 높은 주파수를 생성해낼 수 있다. 제안된 전압 제어 발진기의 측정 결과는 전압 제어 발진기 이득과 전력 소모가 각각 561MHz/V, 14.6mW로 나타났다. 이중 대역 전압 제어 발진기의 위상 잡음은 각각 1.07GHz와 2.07GHz로부터 2MHz 옵셋 주파수에서 -lO2.55dBc/Hz와 -95.88dBc/Hz로 측정되었다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 50% 듀티 싸이클 회로를 지닌 전압 제어 발진기 설계
Ⅲ. 실험 및 고찰
Ⅳ. 결론
참고문헌
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[학술지(정기간행물)] - / Feb.1998 / Low-Power, Low-Phase Noise- CMOS Voltage-Controlled-Oscillator with Integ -rated LC Resonator 33 : 252 ~ 257
[학술지(정기간행물)] - / Dec.2000 / A 2.7V 170-MHz LC Voltage-Controlled- Oscillator for an IF Wireless Transceiver 37 (6) : 808 ~ 811
[학술지(정기간행물)] - / July,2001 / A 2-GHz, Low Noise, Low Power CMOS Frequency Synthesizer with an LC-tuned VCO for Wireless Communications 39 (1) : 14 ~ 19
[학술지(정기간행물)] - / May,1999 / A low-noise, 900-MHz VCO in 0.6-㎛ CMOS 34 : 586 ~ 590
[학술지(정기간행물)] - / Dec.2000 / Design of a 3.3-V 1-GHz CMOS Phase Locked Loop with a Two-Stage Self- Feedback Ring Oscillator 37 (6) : 803 ~ 807
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