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논문 기본 정보

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한국통신학회 한국통신학회논문지 한국통신학회논문지 제27권 6C호
발행연도
2002.6
수록면
594 - 600 (7page)

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일반적인 시프트 연산과 더불어, 비트 분할 시프트 및 멀티미디어 데이터의 다양한 형식변환이 가능한 데이터처리가기 제안되었다. 데이터 형식 변환 연산과 시프트 연산의 유사점을 최대한 이용하여, Barrel 시퍼터를 변형하여, 약간의 interconnection을 추가함으로써, 최소의 하드웨어로써 두 개의 연산을 통합 처리 가능하도록 하였다.제안된 데이터 처리기는 크게 일반적으로 시프트 연산과 pack 연산을 수행하는 시프터 블록과 unpack 연산 등을 수행하는 블록으로 구성된다. 제안된 데이터 처리기는 Verilog HDL를 사용하여 설계되었으며,Compass 0.6㎛ standard cell library를 사용하여 VLSI 구현된 결과에 대하여 논의된다.

목차

요약

ABSTRACT

Ⅰ.서론

Ⅱ.데이터 형식변환 연산

Ⅲ.데이터 시프트와 형식 변환 연산의 통합 처리 방안

Ⅳ.VLSI 아키텍쳐

Ⅴ.VLSI 설계

Ⅵ.결론

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