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대한전자공학회 전자공학회논문지-CI 전자공학회논문지 CI편 제43권 제1호
발행연도
2006.1
수록면
1 - 8 (8page)

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본 논문은 의사난수발생기로 사용할 수 있는 산술 시프트 레지스터(ASR, Arithmetic Shift Register)를 제안한다. 산술 시프트 레지스터는 GF(2ⁿ) 상에서 0이 아닌 초기 값에 0 또는 1이 아닌 임의의 수 D를 곱하는 수열로 정의한다. 그리고 이를 본 논문에서는 ASR-D로 표현한다.
GF(2ⁿ)상에서 'D^k=1'이 되는 t가 't=2ⁿ-1'로 유일하게 되는 비복원다항식이 ASR-D의 특성다항식이며, ASR-D의 주기는 '2ⁿ-1'로 최대주기를 가진다. 갈로이 선형 궤환 시프트 레지스터는 ASR-2^(-1)에 해당한다. 그러므로 제안하는 산술 시프트 레지스터는 갈로이 선형 궤환 시프트 레지스터를 일반화한 것이다. GF(2ⁿ)상의 ASR-D의 선형복잡도는 'n≤LC≤(n²+n)/2'으로 종래의 선형 궤환 시프트 레지스터와 비교하여 안정도가 높다. 제안한 산술 시프트 레지스터의 소프트웨어 구현은 종래의 선형 궤환 시프트 레지스터에 비하여 효율적이며, 하드웨어 복잡도는 동일하다.
제안한 산술 시프트 레지스터는 종래의 선형 궤환 시프트 레지스터와 같이 암호, 오류수정부호, 몬테카를로 적분, 데이터통신 등 여러 분야에서 폭 넓게 사용될 수 있다.

목차

요약

Abstract

Ⅰ. 서론

Ⅱ. 선형 궤환 시프트 레지스터

Ⅲ. 산술 시프트 레지스터

Ⅳ. 구현 및 비교

Ⅴ. 선형 복잡도

Ⅵ. 결론

참고문헌

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