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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2003.11
- 수록면
- 24 - 30 (7page)
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본 논문에서는 m차 기약 AOP를 적용하여 시스템 복잡도를 개선한 GF(2m)상의 새로운 AB²+C 연산기법과 그 하드웨어 구현회로를 제안하였다. 제안된 회로는 병렬 입출력 구조를 가지며, CS, PP 및 MS를 모듈로 하여 구성되며 이들은 각각 AND와 XOR 게이트의 규칙적인 배열구조를 갖는다. 제안된 회로의 시스템 복잡도는 (m+1)²개의 2-입력 AND게이트와 (m+1)(m+2)개의 2-입력 XOR게이트의 회로복잡도와 연산에 소요되는 최대 지연시간은 TA+(1+[log₂m])Tx이다. 제안된 연산기의 시스템 복잡도와 구성상의 특징을 타 연산기를 표로 비교하였고, 그 결과 상대적으로 우수함을 보였다. 또한, 단순하면서도 정규화된 소자 및 결선의 구조는 VLSI 구현에 적합하다.
목차
요 약
Abstract
Ⅰ. 서 론
Ⅱ. GF(2m)상의 승산전개
Ⅲ. GF(2m)상의 AB²+C 연산기 구성
Ⅳ. 비교 및 검토
Ⅴ. 결 론
참 고 문 헌
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