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논문 기본 정보

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학술저널
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저널정보
한국통신학회 한국통신학회논문지 한국통신학회논문지 제29권 1A호
발행연도
2004.1
수록면
93 - 98 (6page)

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이 논문의 연구 히스토리 (2)

2004

직렬 ATA 용 8b/10b 인코더와 디코더 설계 및 구현
허정화 ,  박노경 ,  박상봉 한국통신학회논문지 2004.01 학술저널

2002

직렬 ATA 용 8B/10B 인코더와 디코더 설계 및 구현
허정화 ,  박상봉 ,  박노경 한국통신학회 학술대회논문집 2002.11 학술대회자료

초록· 키워드

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직렬 ATA(Advanced Technology Attachment) 인터페이스는 비교적 저렴하고 성능이 우수하며, 현재 고속의 데이터 전송과 처리량을 요구하는 수요에 적합한 기술이다. 본 논문에서는 직렬 ATA의 링크층에서 오류 감지와 직류 balance를 위한 동작 주파수 150MHz 에서의 8b/10b 인코더 및 디코더의 설계 및 구현 방법과 제작된 칩의 테스트를 위한 테스트 보드 및 테스트 방법을 제시하였다. 제안된 인코더 및 디코더는 각각 5b/6b 과 3b/4b으로 나뉘어서 인코딩 되도록 설계하였으며, Top-Down 설계 방식을 사용하여 Verilog HDL로 기술하고, Synopsys로 합성된 넷리스트로 게이트 수준의 동작을 확인하였다. 제작된 칩은 삼성 0.35㎛ CMOS 표준 셀 라이브러리를 이용하였고, 칩 면적은 1.5mm * 1.5mm 이며, 전원 전압은 3.3V를 사용하였다. 테스트 보드 및 FPGA를 통하여 생성된 입력 테스트 벡터를 이용하여 100MHz로 정상 동작검증을 테스트하였고, ATS2 테스트 장비를 이용하여 100MHz 동작 검증을 하였다. 본 논문에서 제안된 8b/10b 인코더 및 디코더 블록은 고속의 데이터 통신을 위한 IP로써 활용 가능하다.

목차

직렬 ATA 용 8b/10b 인코더와 디코더 설계 및 구현

Ⅰ. 서 론

Ⅱ. 본 론

Ⅲ. 결 론

참 고 문 헌

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