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대한전자공학회 전자공학회논문지-SC 전자공학회논문지 제39권 SC편 제2호
발행연도
2002.3
수록면
48 - 55 (8page)

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본 논문은 전원전압 감지기와 소비전력이 적은 SRAM 쓰기 구동기에 대한 것이다. 전원전압 감지기는 전원전압이 기준전압보다 높을 때는 하이, 낮을 때는 로우를 발생한다. 쓰기 구동기는 쓰기 사이클에서 동작전류를 줄이기 위해 가변 구동력을 가진 이중 크기 구조를 사용하였다. 전원전압 감지 결과에 따라 로우일 경우에는 두개의 구동기를 동작하게 하여 기존과 구동능력이 같고 하이일 경우에는 한개의 구동기만 동작하여 전류를 반으로 흘리도록 하여 저전력을 구현하였다. 0.6㎛, 3.3V/5V, CMOS 모델 파라메타를 가지고 모의 실험한 결과, 제안한 SRAM회로는 Vcc=3.3V에서 기존과 비교하여 전력소모를 22.6%, PDP(power- delay-product)를 12.7% 감소한 결과를 보였다.

목차

Ⅰ. 서론

Ⅱ. 회로 설계, 동작원리 및 모의실험 결과

Ⅲ. 결론

참고문헌

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