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논문 기본 정보
- 자료유형
- 학위논문
- 저자정보
- 지도교수
- 조경록
- 발행연도
- 2014
- 저작권
- 충북대학교 논문은 저작권에 의해 보호받습니다.
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디스플레이 인터페이스가 고속화, 다양화 되면서 데이터 신호의 속도와 채널에 대한 보상 범위가 다양화되었다. 따라서 다양한 데이터 속도와 채널 손실에 대한 보상이 필요하다. 즉 기존의 등화기들은 특정 데이터 속도와 특정 채널에 맞추어 설계되거나 복잡한 알고리즘을 통해 적응형 보상을 한다. 본 논문에서는 주파수-전압 변환기에 의한 pre-equalizing 기능을 갖는 적응형 등화기를 제안한다. FVC는 pre-equalizing 기능의 이득 조절을 위한 제어 신호를 입력 데이터의 주파수로부터 만든다. 제안하는 등화기는 180nm CMOS 공정에서 설계 되었으며, 10mm on-chip 채널에서 2 ~ 4 Gbps데이터 신호에 대해 등화기의 구조 변경없이 신호를 보상한다. 110 um x 52 um를 차지하고, 4 Gbps 동작을 할 때 15 mW를 소모하고 아이오프닝은 0.94 UI를 보인다. 입력 데이터의 속도에 따라 이득 보상이 달라지는 간단한 구조로 설계되기 때문에 설계 간편화를 이룰 수 있다.
목차
Ⅰ. 서 론 1Ⅱ. 디스플레이 인터페이스 42.1 디스플레이 인터페이스 표준 42.2 디스플레이 인터페이스 V-by-One HS 82.3 채널 모델링 9Ⅲ. 등화기 133.1 등화 방법 143.2 이득 조절 가능한 등화기 필터 183.3 제안하는 이득 조절 가능한 등화기 20Ⅳ. 실험 결과 및 비교 264.1 제안하는 등화기의 시뮬레이션 결과 264.2 레이아웃 334.3 기존 등화기와 비교 37Ⅴ. 결 론 39참고문헌 41
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