바디 구동 차동 입력단과 self-cascode 구조를 이용한 0.5 V 2단 연산 증폭기 설계 및 제작 :Design and fabrication of 0.5 V two stage operational amplifier using body-driven differential input stage and self-cascode structure

김정민

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자료유형: 학위논문

저자정보: 김정민 (충북대학교, 충북대학교 대학원)

지도교수: 김영석.

발행연도: 2013

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이용수12

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2013

바디 구동 차동 입력단과 self-cascode 구조를 이용한 0.5 V 2단 연산 증폭기 설계 및 제작

김정민 반도체공학과 2013.01 학위논문

바디 구동 차동 입력단과 Self-cascode 구조를 이용한 0.5 V 2단 연산증폭기 설계 및 제작

김정민 , 이대환 , 백기주 외 2명 전기전자재료학회논문지 2013.01 학술저널

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This thesis presents a design and fabrication of 0.5 V two stage operational amplifier. The proposed operational amplifier utilizes body-driven differential input stage and self-cascode current mirror structure. Cadence Virtuoso is used for layout and the layout data is verified by LVS through Mentor Calibre. The proposed two stage operational amplifier is fabricated using 0.13 ㎛ CMOS process and operation of the proposed opamp at 0.5 V is confirmed. Measured low frequency small signal gain of operational amplifier is 50 ㏈, power consumption is 29 ㎼ and chip area is 75 ㎛ × 90 ㎛.

Ⅰ. 서 론 1
Ⅱ. 저 전압 블록 3
2.1 바디 구동 차동 입력단 3
2.2 Self-cascode 구조 6
2.3 서로 다른 문턱 전압을 갖는 self-cascode 구조 9
2.4 Self-cascode 전류 거울 구조 11
Ⅲ. 제안하는 2단 연산 증폭기 설계 18
3.1 제안하는 2단 연산 증폭기 18
Ⅳ. 시뮬레이션 23
4.1 게이트 구동 차동 입력단 23
4.2 바디 구동 차동 입력단 25
4.3 제안하는 2단 연산 증폭기 28
Ⅴ. 측 정 30
5.1 개별 소자를 이용한 전류 거울 proto-type 30
5.2 제작된 self-cascode 전류 거울 측정 33
5.3 제작된 2단 연산 증폭기 측정 34
Ⅵ. 결 론 39
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