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논문 기본 정보

자료유형
학술저널
저자정보
채용웅 (계명대학교)
저널정보
한국전자통신학회 한국전자통신학회 논문지 한국전자통신학회 논문지 제7권 제2호
발행연도
2012.4
수록면
295 - 301 (7page)

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본 논문에서는 고속 ADC의 앞단에서 사용하기 위한 1 Vpp의 입력 신호 범위에서 12 Bit의 해상도를 갖고 100 MS/s의 샘플링 속도에서 동작하는 SHA를 설계하였다. 제안된 시스템은 입력 주파수가 5 MHz, 샘플링 주파수 100 MHz 일 때 SFDR(Spurious Free Dynamic Range)가 약 66.3 dB로 해상도가 떨어졌으나 feedthrough를 제거한 회로는 SFDR이 약 73 dB로 12 bit 해상도를 갖는다.
#아날로그 디지털 변환기 #샘플 앤드 홀드 증폭기 #스위치 소스 팔로워 #스위치 #피드쓰루 #ADC #SHA #SSF #switch #Feedthrough

목차

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참고문헌 (5)

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J. Bayard / 2005 / A proposal to improve the quality of a sample and hold output voltage / Internaltional Journal of Electronics 92(4):243~249 google schola C. Paulus / 2004 / A 4GS/s 6b flash ADC in0.13um CMOS / Symposium on VLSICircuits Digest of Technical Papers :420~423 google schola 김성권 / 2011 / 모니터링된 배터리 전압 변환을 위한 SAR typed A/D 컨버터의 제작 / 한국전자통신학회 논문지 6(2):256~261 google schola 배성환 / 2009 / Multi-channel Incremental Data Converters / 한국전자통신학회 논문지 4(1):31~34 google schola Behzad Razavi / 1995 / Principles of Data Conversion System Design / IEEE Press google schola

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