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논문 기본 정보

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학술저널
저자정보
박경석 (부경대학교) 최영식 (부경대학교)
저널정보
한국정보전자통신기술학회 한국정보전자통신기술학회 논문지 한국정보전자통신기술학회 논문지 제14권 제6호
발행연도
2021.12
수록면
479 - 486 (8page)

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본 논문에서는 신호감지회로(Signal Sensing Circuit : SSC)를 추가하여 2개의 루프로 구성된 단일 커패시터 루프필터를 가진 극소형 위상고정루프(Phase Locked Loop : PLL)를 제안하였다. 위상고정루프 크기를 극단적으로 줄이기 위하여 가장 많은 면적을 차지하는 수동소자 루프필터를 극소형 단일 커패시터(2pF)로 설계하였다. 신호감지회로가 포함된 내부 부궤환 루프 출력이 외부 부궤환 루프의 단일 커패시터 루프필터 출력에 부궤환 역할을 하여 제안한 극소형 위상고정루프가 안정적으로 동작하도록 설계하였다. 위상고정루프 출력 신호 변화를 감지하는 신호 감지 회로는 루프필터의 커패시턴스 전하량을 조절하여 위상고정루프 출력 주파수의 초과 위상변이를 줄였다. 제안된 구조는 기존 구조에 비해 1/78 정도의 작은 커패시터를 가짐에도 불구하고 지터 크기는 10% 정도 차이가 난다. 본 논문의 위상고정루프는 1.8V 180nm 공정을 사용하였고, Spice를 통해 안정하게 동작하는 시뮬레이션 결과를 보여주었다.
#Negative Feedback #PLL #Single capacitor loop filter. Signal sensing circuit

목차

요약
Abstract
1. 서론
2. 본론
3. 결론
REFERENCES

참고문헌 (10)

참고문헌 신청
W. Chen / 2017 / Challenges and Trends in Modern SoC Design Verification / IEEE Design &Test 34(5):7~22 google schola Adesina / 2019 / Memristor-Based Loop Filter Design for Phase Locked Loop / Journal of Low Power Electronics and Applications 9(3):24~36 google schola 장희승 / 2014 / 두 개의 이득 값을 가지는 전압제어발진기를 이용하여 유효 커패시턴스를 크게 하는 위상고정루프 / 전자공학회논문지 51(7):82~88 dbpia Pang-Jung Liu / 2015 / Techniques of Dual-Path Error Amplifier and Capacitor Multiplier for On-Chip Compensation and Soft-Start Function / IEEE Transactions on power electronics 30(3):1403~1410 google schola Pengfei Liao / 2013 / Embedded Advanced Capacitor Multiplier Compensation for Two-stage Amplifier with Large Capacitive Loads / Communications, Circuits and Systems(ICCCAS) 2:362~365 google schola

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