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논문 기본 정보

자료유형
학술저널
저자정보
이원영 (서울과학기술대학교) 이계민 (서울과학기술대학교)
저널정보
한국전자통신학회 한국전자통신학회 논문지 한국전자통신학회 논문지 제16권 제1호
발행연도
2021.1
수록면
69 - 74 (6page)

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본 논문은 저항과 캐패시터로 구성된 필터를 사용한 저전력 전압 제어 발진기를 소개하고 있다. 제안하는 전압 제어 발진기는 5단의 전류모드 버퍼로 구성되어 있으며, 각 버퍼 셀마다 저항-캐패시터 필터가 입력단과 출력단 사이에 연결되어 있다. 필터는 버퍼 셀 회로에 제로를 추가하게 되며, 제로는 회로 발진 조건을 고주파 대역으로 이동시킴으로써 낮은 전력 소모에도 높은 출력 주파수를 낼 수 있게 한다. 제안하는 회로는 0.18 μm CMOS 공정으로 설계 되었다. 소모 전력은 2.7 GHz 에서 9.83 mW를 소모한다. 기존 회로와 전력 효율을 비교했을 때, 기존 회로는 4.79 pJ/Hz이고 제안하는 회로는 3.64 pJ/Hz로 기존 회로 대비 전력 소모량을 24% 감소시켰다.
#전압 제어 발진기 #클록 #대역폭

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참고문헌 (10)

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D. A. Hodges / 2003 / Analysis and Design of Digital Integrated Circuits / McGraw-Hill google schola A. Ali / 2014 / A 14Bit 1GS/s RF Sampling Pipelined ADC With Background Calibration / IEEE J. of Solid-State Circuits 49(12):2857~2865 google schola 김박사 / 2018 / X 밴드 레이더의 아날로그 - 디지털 신호 변환 / 한국전자통신학회 논문지 13(3):497~502 Crossref 채용웅 / 2011 / 아날로그메모리를 이용한 플레쉬 ADC / 한국전자통신학회 논문지 6(4):545~552 google schola 박소연 / 2019 / 4비트 ADC 반복구조를 이용한 저전력 전류모드 12비트 ADC / 한국전자통신학회 논문지 14(6):1145~1152 dbpia

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