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논문 기본 정보

자료유형
학술저널
저자정보
강성진 (한국기술교육대학교 전기전자통신공학부)
저널정보
한국반도체디스플레이기술학회 반도체디스플레이기술학회지 반도체디스플레이기술학회지 제13권 제4호
발행연도
2014.1
수록면
7 - 13 (7page)

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In this paper, an area-efficient degree-computationless modified Euclidean (DCME) algorithm is presented and implemented for high-speed Reed-Solomon (RS) decoder. The DCME algorithm can be used to solve the key equation in Reed-Solomon decoder to get the error location polynomial and the error value polynomial. A pipelined recursive structure is adopted for reducing the area of key equation solver (KES) block with sacrifice of an amount of decoding latency. For comparisons, KES block for RS(255,239,8) decoder with the proposed architecture is implemented using Verilog HDL and synthesized using Synopsys design tool and 65nm CMOS technology. The synthesis results show that the proposed architecture can be implemented with less gate counts than other existing DCME architectures.
#Reed-Solomon #Modified Euclidean algorithm #Key equation solver #DCME

목차

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S. Lin / 2004 / Error Control Coding: Fundamentals and Applications / Prentice Hall google schola H. Shao / 1985 / A VLSI design of a Pipeline Reed-Solomon Decoder / IEEE Trans. on Computers 34(5):393~403 google schola Hanho Lee / 2003 / High-Speed VLSI Architecture for Parallel Reed-Solomon Decoder / IEEE Trans. on VLSI Systems 11(2):288~294 google schola J. H. Baek / 2006 / New degree computationless modified Euclid's algorithm and architecture for Reed-Solomon decoder / IEEE Trans. Very Large Integr. (VLSI) Syst. 14(8):915~920 google schola J. H. Baek / 2007 / Enhanced degree computationless modified Euclid's algorithm for Reed-Solomon decoders / Electronics Letters 43(3):175~176 google schola

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