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한국정보처리학회 JIPS(Journal of Information Processing Systems) JIPS(Journal of Information Processing Systems) 제15권 제2호
발행연도
2019.1
수록면
374 - 385 (12page)

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This paper presents an optimal implementation of a Daubechies-based pipelined discrete wavelet packettransform (DWPT) processor using finite impulse response (FIR) filter banks. The feed-forward pipelined (FFP)architecture is exploited for implementation of the DWPT on the field-programmable gate array (FPGA). Theproposed DWPT is based on an efficient transpose form structure, thereby reducing its computational complexityby half of the system. Moreover, the efficiency of the design is further improved by using a canonical-signeddigit-based binary expression (CSDBE) and advanced functional sharing (AFS) methods. In this work, the AFStechnique is proposed to optimize the convolution of FIR filter banks for DWPT decomposition, which reducesthe hardware resource utilization by not requiring any embedded digital signal processing (DSP) blocks. Theproposed AFS and CSDBE-based DWPT system is embedded on the Virtex-7 FPGA board for testing. Theproposed design is implemented as an intellectual property (IP) logic core that can easily be integrated into DSPsystems for sub-band analysis. The achieved results conclude that the proposed method is very efficient inimproving hardware resource utilization while maintaining accuracy of the result of DWPT.

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