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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2019.9
- 수록면
- 1,038 - 1,045 (8page)
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본 논문에서는 데이터 전송 속도를 제한하는 채널의 대역폭 문제를 해결하기 위한 방법으로 널리 사용되는 고속 듀오바이너리(duobinary) 송수신단 설계기술 동향을 서술한다. 고속 전송 환경에서는 전송 신호의 주파수가 채널의 대역폭보다 커지게 되어 신호의 손실이 극심해지는 문제가 생긴다. 듀오바이너리 신호는 같은 전송속도를 가지는 Non-Return-to-Zero 신호와 비교했을 때 수식적으로 더 낮은 주파수 대역폭을 가진다. 따라서 고주파 신호일수록 손실정도가 커지는 실제 데이터 채널 환경에서 듀오바이너리 신호기법을 사용함으로써 신호 손실을 효과적으로 줄일 수 있다. 이러한 듀오바이너리 신호기법의 수학적 분석과 더불어 듀오바이너리 신호기법을 고속 송수신단 설계에 적용한 여러 방법들에 대해 탐구한다.
목차
Abstract
요약
Ⅰ. 서론
Ⅱ. 듀오바이너리 신호기법
Ⅲ. 결론
References
참고문헌 (11)
참고문헌 신청
Yue Lu / 2013 / Design Techniques for a 66 Gb/s 46 mW 3-Tap Decision Feedback Equalizer in 65 nm CMOS / IEEE Journal of Solid-State Circuits 48(12):3243~3257
PAVAN KUMAR HANUMOLU / 2011 / EQUALIZERS FOR HIGH-SPEED SERIAL LINKS / International Journal of High Speed Electronics and Systems 15(02):429~458
Jri Lee / 2008 / Design and Comparison of Three 20-Gb/s Backplane Transceivers for Duobinary, PAM4, and NRZ Data / IEEE Journal of Solid-State Circuits 43(9):2120~2133
J.H. Sinsky / 2005 / High-speed electrical backplane transmission using duobinary signaling / IEEE Transactions on Microwave Theory and Techniques 53(1):152~160
Soo-Min Lee / 2014 / An 80 mV-Swing Single-Ended Duobinary Transceiver With a TIA RX Termination for the Point-to-Point DRAM Interface / IEEE Journal of Solid-State Circuits 49(11):2618~2630
PAVAN KUMAR HANUMOLU / 2011 / EQUALIZERS FOR HIGH-SPEED SERIAL LINKS / International Journal of High Speed Electronics and Systems 15(02):429~458
Jri Lee / 2008 / Design and Comparison of Three 20-Gb/s Backplane Transceivers for Duobinary, PAM4, and NRZ Data / IEEE Journal of Solid-State Circuits 43(9):2120~2133
J.H. Sinsky / 2005 / High-speed electrical backplane transmission using duobinary signaling / IEEE Transactions on Microwave Theory and Techniques 53(1):152~160
Soo-Min Lee / 2014 / An 80 mV-Swing Single-Ended Duobinary Transceiver With a TIA RX Termination for the Point-to-Point DRAM Interface / IEEE Journal of Solid-State Circuits 49(11):2618~2630
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