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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2008.1
- 수록면
- 289 - 295 (7page)
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In this paper, we designed the off-line PWM(Pulse width modulation) control IC for flyback type power converter to reduce the standby power consumption. In normal state, this off-line PWM IC generates the output pulse with 4060 ㎑ frequency and duty ratio of 2088 %. When SMPS operates in standby mode, this IC generates the output pulse with 33㎑ frequency and duty ratio of 1 %. SPICE simulation was performed to verify the standby power consumption of the power converter with designed of-line PWM IC. Power converter with designed off-line PWM IC consumes less than 0.3W when it operates in standby mode condition.
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B.T. Huang / 2007 / Design of a two-stage AC/DC converter with standby power losses less than 1 / Proc. Power Conversion Conference : 1630 ~
H.S. Choi / 2005 / Techniques to minimize power consumption of SMPS in standby Mode / Power Electronics Specialists Conference : 2817 ~
J.H. Choi / 2004 / The new technique for the lowest power consumption in the stand-by of power supply / IEEE Power Electronics Specialists Conference : 741 ~
Jai P. Agrawal / 2001 / Power Electronics Systems Theory and Design / Prentice Hall : 71 ~
L. McGarry / 2004 / The standby power challenge / Proc. of IEEE AGEC : 56 ~
H.S. Choi / 2005 / Techniques to minimize power consumption of SMPS in standby Mode / Power Electronics Specialists Conference : 2817 ~
J.H. Choi / 2004 / The new technique for the lowest power consumption in the stand-by of power supply / IEEE Power Electronics Specialists Conference : 741 ~
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