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한국지식정보기술학회 한국지식정보기술학회 논문지 한국지식정보기술학회 논문지 제10권 제3호
발행연도
2015.1
수록면
377 - 388 (12page)

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This paper proposed a systolic array architecture for computing image preprocessing. It is very difficult to be processed images to real time because of operations of local operators. Local operators for computing image preprocessing are used in many image processing tasks, involve replacing each pixel in an image with a valve computed within a local neighborhood of that pixel. Computing such operators at the video rate requires a computing power which is not provided with software method by conventional computer. In this paper, we improved these problem by using systolic arrays. Once the data has been fetched from memory, it was used a lot of times in inside computer system. As a result, image data fetched from memory were used in each cell in CPU many times before it was return to main memory. There, we were able to obtain high throughput with the usual memory bandwidth. A architecture for processing of image preprocessing consisted of one dimensional systolic arrays. A cell has three mask value for image preprocessing. Each cell is executed in parallel at the same time. We had simulated its architecture, and not only achieve good results but also reduce processing time.
#systolic arrays #cells #image preprocessing #local operator #memory bandwidth #mask value

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참고문헌 (18)

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A. L. Fisher / 1983 / Architecture of the PSC : A programmable systolic chip / Proceeding of the 10th Annual Symposium on Computer Architecture google schola Durk-Won Park / 1999 / Systolic arrays for edge detection of image processing / Korea Information Processing Society 6 (8) : 2222 ~ 2232 google schola H. T. Kung / 1982 / Multi Computers and Image Processing : Algorithms and Programs / Academic Press : 373 ~ 384 google schola H. T. Kung / 1982 / Why systolic architecture / Computer Magazine 15 (1) : 37 ~ 46 google schola H. T. Kung / 1984 / VLSI for Pattern Recognition and Image Processing : 9 ~ 24 google schola

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