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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2010.1
- 수록면
- 77 - 83 (7page)
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In this paper, we propose an efficient memory architecture for coeff_token encoding in H.264/AVC standard. The VLCTs used to encode the coeff_token syntax element are implemented with the memory. In general, the size of memory must be reduced because it affects the cost and operation speed of the system. Based on the analysis for the codewords in VLCTs, new memory architecture is designed in this paper. The proposed memory architecture results in about 24% memory saving, compared to the conventional memory architecture.
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G.G.Lee / 2009 / Low complexity and high throughput VLSI architecture for AVC/H.264 CAVLC decoding / IEEE International Symposium on Circuits and Systems : 1229 ~ 1232
H.Chang / 2005 / A novel low-cost high-performance VLSI architecture for MPEG-4 AVC/H.264 CAVLC decoding / IEEE International Symposium on Circuits and Systems : 6110 ~ 6113
H.Huang / 2008 / Architecture design of low-power and low-cost CAVLC decoder for H.264/AVC / IEEE Asia Pacific Conference on Circuits and Systems : 1336 ~ 1339
H.Y.Lin / 2006 / Low power design of H.264 CAVLC Decoder / IEEE International Symposium on Circuits and Systems : 2689 ~ 2692
T.Wiegand / 2003 / Overview of the H.264/AVC video coding standard / IEEE Trans.Circuits and Syst,Video Technol 13 (7) : 560 ~ 576
H.Chang / 2005 / A novel low-cost high-performance VLSI architecture for MPEG-4 AVC/H.264 CAVLC decoding / IEEE International Symposium on Circuits and Systems : 6110 ~ 6113
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H.Y.Lin / 2006 / Low power design of H.264 CAVLC Decoder / IEEE International Symposium on Circuits and Systems : 2689 ~ 2692
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