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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2018.2
- 수록면
- 142 - 145 (4page)
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본 논문에서는 전원보드의 공통모드 노이즈 감쇠를 위한 디커플링 커패시터 회로를 효율적으로 시뮬레이션할 수 있는 구조분할 해석기법을 제시한다. 제시하는 구조분할 해석기법이 적용된 전원보드 설계에서는 보드를 두 부분으로 구조분할하였으며, 분할된 구조와 커패시터 회로의 임피던스 파라미터를 재결합하기 위한 방법을 제시하였다. 구조분할 해석기법을 적용함으로써 공통모드 노이즈 감쇠 시뮬레이션에 수행되는 시간을 46 % 이상 단축하였다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 구조분할 해석기법
Ⅲ. 시뮬레이션 결과
Ⅳ. 결론
References
참고문헌 (5)
참고문헌 신청
[학술대회논문] - T. Ninomiya / 1979 / Commonmode noise generation in a DC-to-DC converter / 1979 IEEE Power Electronics Specialists Conference AES-16 (2) : 256 ~ 263
[학술지(정기간행물)] - G. Feng / 2010 / Analysis of simultaneous switching noise coupling in multilayer power/ground planes with segmentation method and cavity model / IEEE Transactions on Electromagnetic Compatibility 52 (3) : 699 ~ 711
[학술지(정기간행물)] - T. Okoshi / 1976 / The segmentation method-an approach to the analysis of microwave planar circuits / IEEE Transactions on Microwave Theory and Technology 24 (10) : 662 ~ 668
[학술지(정기간행물)] - J. B. Preibisch / 2014 / An efficient analysis of power/ground planes with inhomogeneous substrates using the contour integral method / IEEE Transactions on Electromagnetic Compatibility 56 (4) : 980 ~ 989
[인터넷자원] - Murata / 0000 /
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