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한국산학기술학회 한국산학기술학회 논문지 한국산학기술학회논문지 제10권 제12호
발행연도
2009.12
수록면
3,614 - 3,621 (8page)

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본 논문에서는 이득 및 주파수 특성이 개선된 CMOS 저전압 전류모드 적분기가 설계되었다. 설계된 전류모 드 적분기는 본 논문에서 새롭게 제안한 선형 캐스코드 회로를 기본으로 구성되었다. 제안된 전류모드 적분기는 기존 의 전류미러형 전류모드 적분기의 이득(43.7dB) 및 단위이득주파수(15.2MHz) 비해서 높은 전류이득(47.8dB) 및 단위 이득 주파수(27.8MHz)의 특성을 얻을 수 있었다. 제안된 전류모드 적분기의 응용회로로써 차단주파수 7.03MHz를 갖 는 5차 체비세프 저역통과 필터를 설계하였다. 설계된 모든 회로들은 1.8V-0.18㎛ CMOS 공정파라메터로써 HSPICE 를 이용하여 시뮬레이션되었다.

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