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학술저널
저자정보
윤진영 (고려대학교) 김한빛 (고려대학교) 김희석 (고려대학교) 홍석희 (고려대학교)
저널정보
한국정보보호학회 정보보호학회논문지 정보보호학회논문지 제26권 제6호
발행연도
2016.12
수록면
1,443 - 1,454 (12page)

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하드웨어 기반의 Dual-rail Logic 스타일을 소프트웨어로 구현한 밸런스 인코딩 기법은 추가적인 저장 공간이 필요 없는 효과적인 부채널 분석 대응방법이다. 밸런스 인코딩 기법을 이용하여 암호 알고리즘을 구현하면 암호 알고리즘이 연산되는 동안 입력 값에 상관없이 비밀 정보를 포함하고 있는 중간 값은 항상 일정한 해밍 웨이트 및 해밍 디스턴스를 유지하게 되어 부채널 분석을 어렵게 만드는 효과가 있다. 그러나 기존 연구에서는 밸런스 인코딩 기법을 적용한 Constant XOR 연산만 제안되어 있어 PRINCE와 같이 XOR 연산만으로 구성이 가능한 암호 알고리즘에만 적용이 가능하다는 제한사항이 있다. 따라서 본 논문에서는 ARX 구조 기반의 다양한 대칭키 암호 알고리즘에도 적용이 가능하고, 효율적인 메모리 관리를 위해 Look-up table을 사용하지 않는 새로운 Constant AND, Constant Shift 연산 알고리즘을 최초로 제안하였으며, 상호 정보량 분석을 통해 안전성을 확인하였다.
#Balanced Encoding #Dual-rail with Precharge Logic #Side Channel Analysis #Constant operations

목차

요약
ABSTRACT
I. 서론
II. 관련 연구
III. 제안하는 Constant 연산 알고리즘
IV. 안전성 검증
V. 성능비교 및 결론
References

참고문헌 (17)

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[인터넷자원] - / / Segyeilbo google schola [학술지(정기간행물)] - Kocher, P. C. / 1999 / “Differential power analysis”, CRYPTO 1999 / LNCS 1666 : 388 ~ 397 google schola [학술대회논문] - Goubin, L. / 1999 / DES and Differential Power Analysis. The ‘Duplication’ Method / CHES 1999 : 158 ~ 172 google schola [학술대회논문] - Tiri, K. / 2004 / A Logic Level Design Methodology for a Secure DPA Resistant ASIC or FPGA Implementation / DATE 2004 : 246 ~ 251 google schola [학술대회논문] - Hoogvorst, P. / 2011 / Software implementation of dual-rail representation / COSADE 2011 : 73 ~ 81 google schola

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