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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2012.12
- 수록면
- 343 - 348 (6page)
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본 논문에서는 Digital PFC Controller에 적합한 11비트 100KS/s의 Algorithmic ADC를 설계하였다. 설계한 Algorithmic ADC는 PFC controller에 적합한 11비트 해상도를 만족하면서 반복적인 순환구조의 동작으로 인해 전체 크기를 줄일 뿐 아니라 소비 전류를 최소화 할 수 있다. 본 논문의 Algorithmic ADC는 0.18um 1Poly-3Metal의 CMOS 공정으로 제작 되었으며 100KS/s의 동작 속도에 SNDR 66.7dB, ENOB 10.78비트의 성능을 가진다. 또한 소비전류는 5V 전원 전압에서 780uA이며 설계된 ADC의 칩 면적은 0.27mm²이다.
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참고문헌 (9)
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1. [학술지(정기간행물)] - 유성목 / 2011 / 3중 모드 DC-DC 벅 변환기 설계 / 전기전자학회논문지 15 (2) : 134 ~ 142
2. [기타자료] - Seong-Mok Yu / 2009 / Load Adaptive Control for Mixed-signal PFC Control IC / Power Electronics and Drive Systems : 1222 ~ 1227
3. [단행본] - B. Razavi / 1995 / Principles of Data Conversion System Design / IEEE Press
4. [기타자료] - P. E. Allen / 2002 / CMOS Analog Circuit Design / 2nDesign of a Algorithmic ADC for Digital PFC Controllerd ed
5. [학술대회논문] - O. E. Erdogan / 1999 / A 12-b digital-background-calibrated algorithmic ADC with-90 dB THD / IEEE International Solid-State Circuits Conference : 316 ~ 317
2. [기타자료] - Seong-Mok Yu / 2009 / Load Adaptive Control for Mixed-signal PFC Control IC / Power Electronics and Drive Systems : 1222 ~ 1227
3. [단행본] - B. Razavi / 1995 / Principles of Data Conversion System Design / IEEE Press
4. [기타자료] - P. E. Allen / 2002 / CMOS Analog Circuit Design / 2nDesign of a Algorithmic ADC for Digital PFC Controllerd ed
5. [학술대회논문] - O. E. Erdogan / 1999 / A 12-b digital-background-calibrated algorithmic ADC with-90 dB THD / IEEE International Solid-State Circuits Conference : 316 ~ 317
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