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본 논문은 고성능 이미지 센서인 CCD 시스템에서 전체 시스템의 성능을 좌우하는 아날로그 프론트 엔드(analog-front end, AFE)를 영상신호처리 유닛과 함께 SoC로써 구현한 설계에 관한 것이다. 데이터의 전송속도가 빨라짐에 따라 데이터 샘플링의 불확실성을 낮추었으며, 의 높은 이득을 가지는 지수함수적인 가변 이득단의 대역폭을 구현하기 위한 구조 및 증폭기의 정밀도를 높이기 위한 기생 커패시턴스에 둔감한 커패시터 배열을 개발하였다. 또한, 블랙-레벨 상쇄를 위한 아날로그 및 디지털 영역에서의 이중 블랙 레벨 상쇄를 효과적으로 구현하였다. 제안된 구조를 CMOS 공정으로 구현하였으며, 10-bit 해상도의 전체 CCD 카메라 시스템에 적용하여 그 동작을 검증하였다. 제안한 AFE는 3.3 V 공급전압 및 15 MHz의 데이터 전송속도에서 80 mA를 소모하였다.
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1. [학술지(정기간행물)] - Hynecek / 1992 / Theoretical Analysis and Optimization CDS signal Processing Method for CCD Image Sensors / IEEE Trans. on Electron Devices ED-39 (11) : 2497 ~ 2507
2. [학술지(정기간행물)] - R. Harjani / 1995 / A low-power CMOS VGA for 50 Mb/s disk drive read channels / Trans. Circuits Syst. II 42 : 370 ~ 376
3. [학술대회논문] - Y. Fujimoto / 2002 / A switched-capacitor variable gain amplifierfor CCD image sensor interface system / Proc. 28th Eur.Solid-State Circuits Conf. : 94 ~ 95
2. [학술지(정기간행물)] - R. Harjani / 1995 / A low-power CMOS VGA for 50 Mb/s disk drive read channels / Trans. Circuits Syst. II 42 : 370 ~ 376
3. [학술대회논문] - Y. Fujimoto / 2002 / A switched-capacitor variable gain amplifierfor CCD image sensor interface system / Proc. 28th Eur.Solid-State Circuits Conf. : 94 ~ 95
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