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논문 기본 정보

자료유형
학술저널
저자정보
최인준 (충남대학교) 김지훈 (서울과학기술대학교)
저널정보
대한전자공학회 전자공학회논문지 전자공학회논문지 제53권 제4호
발행연도
2016.4
수록면
48 - 58 (11page)

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본 논문은 GF(64) (160,80) 정규 (2,4) 비이진 LDPC 코드 복호기를 위한 높은 처리량의 병렬 아키텍처를 제안한다. 복호기의 복잡도를 낮추기 위해 체크 노드와 변수 노드의 차수가 작은 코드를 사용하며 뛰어난 에러 정정 성능을 위해 높은 위수의 유한체에서 정의된 코드를 사용한다. 본 논문은 Fully-parallel 아키텍처를 설계하고 체크 노드와 변수 노드를 interleaving하여 복호기의 데이터 처리량을 향상시켰다. 또한 체크 노드의 초기화 지연을 단축시킬 수 있는 조기 분류 기법을 제안하여 데이터 처리량을 추가로 향상시켰다. 제안된 복호기는 1 iteration에 37사이클이 소요되며 625MHz 동작주파수에서 1402Mbps의 데이터 처리량을 갖는다.

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 비이진 LDPC 코드 및 복호 알고리즘
Ⅲ. 체크 노드 및 변수 노드 설계
Ⅳ. 높은 처리량을 갖는 복호기 설계
Ⅴ. 복호기 성능 및 구현결과
Ⅵ. 결론
REFERENCES

참고문헌 (16)

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