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논문 기본 정보

자료유형
학술저널
저자정보
배기철 신경욱 (금오공과대학교)
저널정보
한국정보통신학회 한국정보통신학회논문지 한국정보통신학회논문지 제20권 제2호
발행연도
2016.2
수록면
351 - 358 (8page)

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경량 블록 암호 알고리즘 CLEFIA의 효율적인 하드웨어 설계에 대하여 기술한다. 설계된 CLEFIA 보안 프로세서는 128/192/256-비트의 세 가지 마스터키 길이를 지원하며, 변형된 GFN(Generalized Feistel Network) 구조를 기반으로 8-비트 데이터 패스로 구현되었다. 라운드키 생성을 위한 중간키 계산용 GFN과 암호‧복호 라운드 변환용 GFN을 단일 데이터 프로세싱 블록으로 구현하여 하드웨어 복잡도를 최소화하였다. 본 논문의 GFN 블록은 라운드 변환과 128-비트의 중간 라운드키 계산을 위한 4-브랜치 GFN과 256-비트의 중간 라운드키 계산을 위한 8-브랜치 GFN으로 재구성되어 동작하도록 설계되었다. Verilog HDL로 설계된 CLEFIA 보안 프로세서를 FPGA로 구현하여 정상 동작함을 확인하였다. Vertex5 XC5VSX50T FPGA에서 최대 112 ㎒ 클록으로 동작 가능하며, 마스터키 길이에 따라 81.5 ~ 60 Mbps의 성능을 갖는 것으로 평가되었다.

목차

요약
ABSTRACT
Ⅰ. 서론
Ⅱ. 경량 블록암호 알고리즘 CLEFIA[8]
Ⅲ. CLEFIA 보안 프로세서 설계
Ⅳ. 기능 검증
Ⅴ. 결론
REFERENCES

참고문헌 (14)

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