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논문 기본 정보

자료유형
학술저널
저자정보
박민우 (한국항공대학교) 이상우 (한국항공대학교) 김태환 (한국항공대학교)
저널정보
대한전자공학회 전자공학회논문지 전자공학회논문지 제52권 8호
발행연도
2015.8
수록면
40 - 48 (9page)

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본 논문에서는 다중 입력 다중 출력 시스템을 위한 전 처리 과정인 QR Decomposition (QRD) 과 Lattice Reduction (LR) 에 대하여, 두 과정의 연산의 공유성을 바탕으로 이를 공동으로 처리하는 프로세서를 제안한다. 제안하는 전 처리 프로세서는 다중 사이클 아키텍처로 설계하여 하드웨어 복잡도를 낮추었고, 두 전 처리 과정을 채널 환경에 따라 선택적으로 수행한다. 제안하는 전 처리 프로세서는 0.18-μm CMOS공정의 셀 라이브러리를 사용하여 139K의 논리 게이트로 구현되었고, 최대 117MHz의 동작주파수에서 8 × 8 행렬에 대한 QRD와 LR의 수행에 대하여 5μs의 latency를 갖는다.

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. MIMO 심볼 검파 및 전 처리
Ⅲ. 제안하는 전 처리 프로세서
Ⅳ. 구현 결과 및 고찰
V. 결론
REFERENCES

참고문헌 (17)

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