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저자정보
Jing Wang (Waseda University) Qiang Li (Waseda University) Li Ding (Waseda University) Yasuaki Inoue (Waseda University)
저널정보
대한전자공학회 ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications ITC-CSCC 2015
발행연도
2015.6
수록면
798 - 801 (4page)

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In this paper, a nanopower supply-insensitive CMOS threshold voltage extractor circuit is proposed, which can meet today’s industry demands for portable devices to operate under very low power consumption and large supply voltage variations. Simulation results, based on CMOS 0.18um process, show that, the threshold voltage of CMOS transistors can be extracted with less than 0.01% error for wide power supply range. At the same time, the proposed V<SUB>th</SUB> extractor can operated with less than 300nW power consumption for 1.3V power supply.
#Analog VLSI #CMOS #low power circuits #supply-insensitive #V< #SUB> #th< #/SUB> # extractor

목차

Abstract
1. Introduction
2. Proposed circuit description and analysis
3. Simulation results and comparison
4. Conclusions
References

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