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논문 기본 정보

자료유형
학술저널
저자정보
성의석 (경남대) 황선환 (경남대)
저널정보
전력전자학회 전력전자학회논문지 전력전자학회 논문지 제20권 제3호
발행연도
2015.6
수록면
201 - 208 (8page)

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The effects of dead-time and offset error, which cause output current distortion in single-phase grid-connected inverters are investigated this paper. Offset error is typically generated by measuring phase current, including the voltage unbalance of analog devices and non-ideal characteristics in current measurement paths. Dead-time inevitably occurs during generation of the gate signal for controlling power semiconductor switches. Hence, the performance of the grid-connected inverter is significantly degraded because of the current ripples. The current and voltage, including ripple components on the synchronous reference frame and stationary reference frame, are analyzed in detail. An algorithm, which has the proportional resonant controller, is also proposed to reduce current ripple components in the synchronous PI current regulator. As a result, computational complexity of the proposed algorithm is greatly simplified, and the magnitude of the current ripples is significantly decreased. The simulation and experimental results are presented to verify the usefulness of the proposed current ripple reduction algorithm.

목차

Abstract
1. 서론
2. 데드타임의 영향
3. 전류측정오차의 영향
4. 제안된 전류리플 저감 알고리즘
5. 시뮬레이션
6. 실험
7. 결론
References

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