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논문 기본 정보

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학술저널
저자정보
Soohyun Jang (Korea Aerospace University) Seongjoo Lee (Sejong University) Yunho Jung (Korea Aerospace University)
저널정보
대한전자공학회 JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE Journal of Semiconductor Technology and Science Vol.15 No.2
발행연도
2015.4
수록면
255 - 266 (12page)

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In this paper, a low-complexity and lowpower soft output multiple input multiple output (MIMO) symbol detector is proposed for mobile devices with two transmit and two receive antennas. The proposed symbol detector can support both the spatial multiplexing mode and spatial diversity mode in single hardware and shows the optimal maximum likelihood (ML) performance. By applying a multistage pipeline structure and using a complex multiplier based on the polar-coordinate, the complexity of the proposed architecture is dramatically decreased. Also, by applying a clockgating scheme to the internal modules for MIMO modes, the power consumption is also reduced. The proposed symbol detector was designed using a hardware description language (HDL) and implemented using a 65nm CMOS standard cell library. With the proposed architecture, the proposed MIMO detector takes up an area of approximately 0.31mm2 with 183K equivalent gates and achieves a 150Mbps throughput. Also, the power estimation results show that the proposed MIMO detector can reduce the power consumption by a maximum of 85% for the various test cases.

목차

Abstract
Ⅰ. INTRODUCTION
Ⅱ. SYSTEM MODEL
Ⅲ. SYMBOL DETECTION ALGORITHM
Ⅳ. HARDWARE ARCHITECTURE DESIGN FOR THE PROPOSED MIMO SYMBOL DETECTOR
Ⅴ. IMPLEMENTATION AND VERIFICATION RESULTS
Ⅵ. CONCLUSIONS
REFERENCES

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