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논문 기본 정보

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Jong Kang Park (Sungkyunkwan Univ.) Jun Young Moon (Sungkyunkwan Univ.) Kyunghoon Kim (Sungkyunkwan Univ.) Youngoo Yang (Sungkyunkwan Univ.) Jong Tae Kim (Sungkyunkwan Univ.)
저널정보
대한전자공학회 JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE Journal of Semiconductor Technology and Science Vol.14 No.6
발행연도
2014.12
수록면
718 - 727 (10page)

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In a wireless communications system, a pre-distorter is often used to compensate for the nonlinear distortions that result from operating a power amplifier near the saturation region, thereby improving system performance and increasing the spectral efficiency for the communication channels. This paper presents a new VLSI design for the polynomial digital pre-distorter (DPD). The proposed DPD uses a Coordinate Rotation Digital Computing (CORDIC) processor and a PD process with a fullypipelined architecture. Due to its simple and regular structure, it can be a competitive design when compared to existing polynomial-type and approximated DPDs. Implementing a fifth-order distorter with the proposed design requires only 43,000 logic gates in a 0.35 ㎛ CMOS standard cell library.

목차

Abstract
Ⅰ. INTRODUCTION
Ⅱ. H/W DESIGN FOR DIGITAL PREDISTORTION
Ⅲ. EXPERIMENTS
Ⅳ. CONCLUSION
REFERENCES

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