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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2011.6
- 수록면
- 1,645 - 1,648 (4page)
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In this paper, we designed and evaluated the bus interface unit for a 32bit asynchronous processor with asynchronous cache system. The bus interface unit supports to connect an asynchronous processor to AMBA system bus as a reusable IP. It has additional latch and flip-flop synchronizing with the system clock that eliminates meta-stability of the transferred data. The bus interface unit was synthesised using 0.13㎛ CMOS process technology. According to simulation, it works fine on the platform that consists of asynchronous processor and AMBA bus system.
목차
Abstract
Ⅰ. 서론
Ⅱ. 버스 인터페이스 유닛의 설계 및 구현
Ⅲ. 동기화 실패 문제
Ⅳ. 플랫폼에서의 검증
Ⅴ. 결론
참고문헌
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