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본 논문에서는 10-bit 해상도의 Two-Step Single-Slope A/D 변환기를 이용한 고속 CMOS Image Sensor(CIS)를 제안하였다. 제안하는 A/D 변환기는 5-bit coarse ADC 와 6-bit fine ADC 로 구성되어 있으며, 기존의 Single-Slope A/D 변환기보다 10배 이상의 변환속도를 나타내었다. 또한 고속 동작에서 적은 노이즈 특성을 갖기 위해 Digital Correlated Double Sampling(D-CDS) 회로를 제안하였다. 설계된 A/D 변환기는 0.13um 1-poly 4-metal CIS 공정으로 제작되었으며 QVGA(320×240)급 해상도를 갖는다. 제작된 칩의 유효면적은 5mm×3mm 이며 3.3V 전원전압에서 약 35mW의 전력소모를 나타내었다. 변환속도는 10us 이었으며, 프레임율은 220 frames/s 으로 측정되었다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. Two-step SS-ADC을 이용한 CIS의 구조와 동작원리
Ⅲ. 실험 및 결과
Ⅳ. 결론
REFERENCES
참고문헌 (9)
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1. [학술대회논문] - / 2000 / sensor with column-to-column FPN reduction / Proc. IEEE ISSCC Dig. Tech. Papers : 108 ~ 109
2. [학술대회논문] - S. Lim / 2004 / A new correlated double sampling and single slope ADC circuit for CMOS image sensors / in Proc. Int. SoC Des. Conf : 129 ~ 131
3. [학술지(정기간행물)] - M. F. Snoeij / 2007 / Multiple-ramp column-parallel ADC architectures for CMOS image sensors / IEEE J. Solid-State Circuits 42 (12) : 2968 ~ 2967
4. [학술대회논문] - J. Lee / 2007 / A 10 b column-wise two-stage single-slope ADC for high-speed CMOS image sensor / Proc. IEEE Int. Image Sensor Workshop : 196 ~ 199
5. [학술대회논문] - Y. Nitta / 2006 / High-Speed Digital Double Sampling with Analog CDS on Column Parallel ADC Architecture for Low-Noise Active Pixel Sensor / ISSCC Dig. Tech. Papers : 500 ~ 501
2. [학술대회논문] - S. Lim / 2004 / A new correlated double sampling and single slope ADC circuit for CMOS image sensors / in Proc. Int. SoC Des. Conf : 129 ~ 131
3. [학술지(정기간행물)] - M. F. Snoeij / 2007 / Multiple-ramp column-parallel ADC architectures for CMOS image sensors / IEEE J. Solid-State Circuits 42 (12) : 2968 ~ 2967
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5. [학술대회논문] - Y. Nitta / 2006 / High-Speed Digital Double Sampling with Analog CDS on Column Parallel ADC Architecture for Low-Noise Active Pixel Sensor / ISSCC Dig. Tech. Papers : 500 ~ 501
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