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이용수
요약
ABSTRACT
Ⅰ. 서론
Ⅱ. 저잡음 증폭기의 설계
Ⅲ. 모의실험 결과
Ⅳ. 결론
참고문헌
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2008 .06
Low Cost CMOS LNA Design Using On-Chip Size Efficient Inductors
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A 2 ㎓ 20 ㏈m IIP3 Low-Power CMOS LNA with Modified DS Linearization Technique
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65 ㎚ CMOS 기술을 적용한 20 ㎓ 이하의 1 단 저잡음 증폭기 설계
전자공학회논문지-SD
2009 .06
A Simple and Analytical Design Approach for Input Power Matched On-chip CMOS LNA
JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE
2002 .03
Ku-band LNA Design in 0.18 ㎛ Logic CMOS Technology
대한전자공학회 ISOCC
2005 .10
CMOS 0.18㎛ 공정을 이용한 Active Inductor Load를 가지는 3-5㎓ UWB LNA 설계
대한전자공학회 학술대회
2007 .11
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