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이용수
요약
Ⅰ. 서론
Ⅱ. 고속화를 위한 Viterbi 복호기 모듈 분석
Ⅲ. 구현 결과
Ⅳ. 결론
참고문헌
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20Mbps급 64state Viterbi 복호기 구조설계 및 CPLD 구현
한국정보통신학회논문지
1999 .12
Zero-IF 방식의 50Mbps 급 QPSK 변조기 CPLD 구현
한국통신학회 학술대회논문집
1999 .07
시간제약 조건을 고려한 CPLD 기술 매핑 알고리즘 개발 ( Development of Technology Mapping Algorithm for CPLD by Considering Time Constraint )
전자공학회논문지-C
1999 .06
CPLD를 이용한 2상 스텝모터의 마이크로테스핑 구현
정보 및 제어 논문집
2011 .10
시간 제약 조건하에서 면적을 고려한 효율적인 CPLD 기술 매핑 ( An Efficient CPLD Technology Mapping considering Area under Time Constraint )
전자공학회논문지-SD
2001 .01
Radix-4 방식의 64-state Viterbi 복호기 구조 설계 및 구현 ( A Design and Implementation of 64-state Viterbi Decoder with Radix-4 Method )
한국통신학회논문지
2000 .04
12 Mbps 무선 LAN 비터비 디코더 설계 및 구현
한국통신학회 학술대회 및 강연회
2000 .05
CPLD를 이용한 2상 스테핑 모터 드라이버의 성능개선
대한전기학회 학술대회 논문집
2003 .11
CPLD를 이용한 2상 스테핑 모터 드라이버의 성능개선
대한전기학회 학술대회 논문집
2003 .11
CPLD칩을 이용한 다채널 가스누출 경보시스템의 설계 및 제작
대한전자공학회 학술대회
1999 .11
CPLD를 이용한 2상 스테핑 모터 드라이버의 성능개선
전기학회논문지 D
2004 .09
고속 Viterbi 복호기를 위한 메모리 관리 ( Memory Management in High-Speed Viterbi Decoders )
전자공학회논문지-C
1998 .07
적응 양자화에 의한 Viterbi 복호 알고리즘 ( Viterbi Decoding based on Adaptive Quantization )
한국통신학회 학술대회논문집
1998 .01
시간제약 조건하에서 순차 회로를 위한 CPLD 기술 매핑 제어 알고리즘 개발 ( Development of CPLD technology mapping control algorithm for Sequential Circuit under Time Constraint )
전자공학회논문지-T
1999 .12
CPLD를 고려한 RTL 바인딩과 저전력 기술 매핑
한국컴퓨터정보학회논문지
2006 .05
IEEE 802.11a 고속 무선 LAN 모뎀을 위한 54Mbps Punctured Viterbi Decoder 설계 및 구현
한국통신학회 학술대회 및 강연회
2002 .04
Viterbi 디코더 설계 및 성능 분석
한국통신학회 학술대회논문집
1993 .07
CDMA용 Viterbi 복호기의 최적구조
대한전자공학회 학술대회
1994 .07
CDMA용 Viterbi 복호기의 최적구조 ( Optimal Structure of Viterbi Decoder for CDMA System )
대한전자공학회 학술대회
1994 .07
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