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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2012.11
- 수록면
- 631 - 634 (4page)
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다이내믹 프로그래밍 정합은 좌·우 영상의 스캔라인 간 정합오차를 나타내는 시차공간영상에서 최소비용경로를 찾아 시차를 계산하는 방법이다. 하지만 일반적으로 시차공간영상을 생성하기 위해서는 많은 시간이 소모될뿐 아니라 메모리 사용을 필요로 한다. 이에 본 논문에서는 불필요한 연산을 줄이면서 최소의 레지스터를 사용하여 메모리 사용을 대체할 수 있는 다이내믹 프로그래밍 정합 하드웨어 구조를 제안한다. 제안하는 하드웨어 구조는 XilinX Virtex4 LX60 FPGA 기반의 플랫폼을 통해 검증되었으며 실시간 성능을 확인하였다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 제안하는 하드웨어 구조
Ⅲ. 구현 및 검증 결과
Ⅳ. 결론
참고문헌
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